Slave FIFOのファームウェアがどうしても動作せず,納得がいかないので
高須さんからお借りしているメーカ不明のFX2LP基板のヘッダピンの結線を
ひとつひとつチェックしてみました.
![](https://blogimg.goo.ne.jp/user_image/30/74/fa44ec53e50700ca08862dca1c5954b8.jpg)
そうしたら,バスの読み書きの方向を指定するRDY1/SLWRとRDY0/SLRDの
シルクが逆になっていることが判明.バスからFIFOへの書き込みのために
SLWRをアクティブにしているつもりが,その逆方向のSLRDをアクティブに
していました.
正しくSLWRをlowに,SLRDをhighに設定したところ,無事にslave FIFOの
動作が確認できました.こんなことで日曜日を丸一日溶かすことになろうとは.
![](https://blogimg.goo.ne.jp/user_image/21/c7/3daf6f18b8bf420faf6e835c7a250583.jpg)
FX2LP基板単体の動作チェックでは,IFCLKに内部クロックを指定していますが,
これをMAX2771からのCLKOUTに切り替えればI/Qデータが取り込めるはず.
高須さんからお借りしているメーカ不明のFX2LP基板のヘッダピンの結線を
ひとつひとつチェックしてみました.
![](https://blogimg.goo.ne.jp/user_image/30/74/fa44ec53e50700ca08862dca1c5954b8.jpg)
そうしたら,バスの読み書きの方向を指定するRDY1/SLWRとRDY0/SLRDの
シルクが逆になっていることが判明.バスからFIFOへの書き込みのために
SLWRをアクティブにしているつもりが,その逆方向のSLRDをアクティブに
していました.
正しくSLWRをlowに,SLRDをhighに設定したところ,無事にslave FIFOの
動作が確認できました.こんなことで日曜日を丸一日溶かすことになろうとは.
![](https://blogimg.goo.ne.jp/user_image/21/c7/3daf6f18b8bf420faf6e835c7a250583.jpg)
FX2LP基板単体の動作チェックでは,IFCLKに内部クロックを指定していますが,
これをMAX2771からのCLKOUTに切り替えればI/Qデータが取り込めるはず.
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